三星电子展出业界最小3D堆叠晶体管，栅极间距42nm
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三星电子在近日美国举行的VLSI 2026上，展示了其在实现栅极间距为42nm的3D堆叠场效应晶体管（3D堆叠FET）方面取得的成果。该技术将晶体管垂直堆叠而非放置在平面上，预计将应用于系统半导体领域。
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中
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国内刻蚀及薄膜沉积设备龙头。2025年报明确提到金属栅极工艺演进和3D堆叠高深宽比刻蚀（40:1~60:1）。3D堆叠FET的核心制造依赖等离子体刻蚀和薄膜沉积设备，公司是该领域国产化关键供应商。5日主力净流入4.03亿元，资金面强势净流入。
北
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国内最大半导体设备平台，营收93.3%来自电子工艺装备（刻蚀/薄膜沉积/清洗/炉管等）。3D堆叠FET的全流程制造（ALD介质沉积、金属栅极刻蚀、清洗等）需要多品类前道设备支撑，公司是国产替代核心受益方。5日主力净流入18.85亿元，资金面极为强势。
拓
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国内ALD（原子层沉积）设备龙头，产品包括PE-ALD和Thermal-ALD系列。3D堆叠FET需要在栅极和沟道界面实现原子级精度的高k介质/金属栅极沉积，ALD是最关键工艺设备。公司是国内唯一量产型ALD设备供应商，直接受益于3D堆叠FET工艺对ALD设备的新增需求。
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公告显示具备3D堆叠电镀设备（Ultra ECP 3d，用于TSV填充）、PE-ALD炉管、TSV清洗设备等产品线。3D堆叠FET的垂直互联和三维制造需要TSV电镀/清洗/ALD沉积等新工艺，公司多项产品直接对应。
南
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承担国家02专项'ALD金属有机前驱体产品开发'，公告显示已实现硅前驱体/金属前驱体/高k前驱体/低k前驱体全覆盖，是国内核心前驱体材料供应商。3D堆叠FET的高k金属栅极ALD沉积需要大量前驱体材料，公司直接受益于工艺节点升级带来的材料需求增量。
长
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全球封测龙头，公告明确拥有2.5D/3D封装、晶圆级封装（WLP）、系统级封装（SiP）等先进封装技术。3D堆叠FET的垂直集成架构与3D封装技术高度协同，技术路线外溢效应显著，公司将受益于3DIC封装需求的增长。
通
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国内封测龙头之一，公告显示掌握TSV硅通孔、2.5D/3D先进封装技术（含HDFO、SWIFT等方案）。3D堆叠晶体管技术路线与TSV/3D封装技术形成协同，作为A股唯一获国家大基金一期和二期同时投资的封测公司，受益逻辑清晰。
华
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年报明确披露掌握TSV、Bumping、2.5D/3D封装、Fan-Out等先进封装技术。3D堆叠FET的垂直互联架构与TSV/3D封装技术具有强协同效应，公司作为国内先进封装主力供应商将承接3DIC封装需求。
晶
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专注于TSV晶圆级封装，公告明确提到3D堆叠技术利用TSV实现最短垂直互连，受益于2.5D/3D封装高增速（YOLE数据）。3D堆叠FET的垂直集成需要TSV实现层间互联，与公司核心业务CS晶圆级封装高度对应。
中
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国内晶圆代工龙头，提供14nm及以下先进制程代工。三星3D堆叠FET技术突破将加速国内代工厂对GAA/3D堆叠器件技术路线的跟进，中芯国际作为先进制程代工主力将受益于国产替代加速趋势。
华
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国内EDA龙头，提供覆盖模拟/数字/存储/射频全流程EDA工具及先进封装EDA。3D堆叠FET的全新器件结构需要新一代EDA工具支持设计与仿真验证，公司作为国内EDA领军将受益于技术迭代带来的国产替代机遇。
概
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国内EDA领军，产品覆盖制造类和设计类EDA工具，公告显示其围绕DTCO（工艺与设计协同优化）进行战略布局。3D堆叠FET的先进工艺开发需要DTCO方法学支持，公司在此领域有深度布局且具国际竞争力。